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74LVC74A	文件：99.08 Kbytes Page：10 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger DESCRIPTION The74LVC74Aisahigh-performance,low-voltageSi-gateCMOSdeviceandsuperiortomostadvancedCMOScompatibleTTLfamilies. FEATURES ?Widesupplyvoltagerangeof1.2Vto3.6V ?InaccordancewithJEDECstandardno.8-1A. ?Inputsacceptvoltagesupto5.5V ?CMOSlowpowerc	PHIPhilips Semiconductors 飛利浦荷蘭皇家飛利浦	PHI
74LVC74A	文件：266.16 Kbytes Page：16 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger 1.Generaldescription The74LVC74AisadualedgetriggeredD-typeflip-flopwithindividualdata(nD)inputs,clock(nCP) inputs,set(nSD)and(nRD)inputs,andcomplementarynQandnQoutputs. ThesetandresetareasynchronousactiveLOWinputsandoperateindependentlyoftheclock input	NEXPERIANexperia B.V. All rights reserved 安世安世半導(dǎo)體(中國)有限公司	NEXPERIA
74LVC74ABQ	文件：266.16 Kbytes Page：16 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger 1.Generaldescription The74LVC74AisadualedgetriggeredD-typeflip-flopwithindividualdata(nD)inputs,clock(nCP) inputs,set(nSD)and(nRD)inputs,andcomplementarynQandnQoutputs. ThesetandresetareasynchronousactiveLOWinputsandoperateindependentlyoftheclock input	NEXPERIANexperia B.V. All rights reserved 安世安世半導(dǎo)體(中國)有限公司	NEXPERIA
74LVC74AD	文件：99.08 Kbytes Page：10 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger DESCRIPTION The74LVC74Aisahigh-performance,low-voltageSi-gateCMOSdeviceandsuperiortomostadvancedCMOScompatibleTTLfamilies. FEATURES ?Widesupplyvoltagerangeof1.2Vto3.6V ?InaccordancewithJEDECstandardno.8-1A. ?Inputsacceptvoltagesupto5.5V ?CMOSlowpowerc	PHIPhilips Semiconductors 飛利浦荷蘭皇家飛利浦	PHI
74LVC74AD	文件：266.16 Kbytes Page：16 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger 1.Generaldescription The74LVC74AisadualedgetriggeredD-typeflip-flopwithindividualdata(nD)inputs,clock(nCP) inputs,set(nSD)and(nRD)inputs,andcomplementarynQandnQoutputs. ThesetandresetareasynchronousactiveLOWinputsandoperateindependentlyoftheclock input	NEXPERIANexperia B.V. All rights reserved 安世安世半導(dǎo)體(中國)有限公司	NEXPERIA
74LVC74ADB	文件：99.08 Kbytes Page：10 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger DESCRIPTION The74LVC74Aisahigh-performance,low-voltageSi-gateCMOSdeviceandsuperiortomostadvancedCMOScompatibleTTLfamilies. FEATURES ?Widesupplyvoltagerangeof1.2Vto3.6V ?InaccordancewithJEDECstandardno.8-1A. ?Inputsacceptvoltagesupto5.5V ?CMOSlowpowerc	PHIPhilips Semiconductors 飛利浦荷蘭皇家飛利浦	PHI
74LVC74APW	文件：99.08 Kbytes Page：10 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger DESCRIPTION The74LVC74Aisahigh-performance,low-voltageSi-gateCMOSdeviceandsuperiortomostadvancedCMOScompatibleTTLfamilies. FEATURES ?Widesupplyvoltagerangeof1.2Vto3.6V ?InaccordancewithJEDECstandardno.8-1A. ?Inputsacceptvoltagesupto5.5V ?CMOSlowpowerc	PHIPhilips Semiconductors 飛利浦荷蘭皇家飛利浦	PHI
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74LVC74APWDH	文件：99.08 Kbytes Page：10 Pages	DualD-typeflip-flopwithsetandreset;positive-edgetrigger DESCRIPTION The74LVC74Aisahigh-performance,low-voltageSi-gateCMOSdeviceandsuperiortomostadvancedCMOScompatibleTTLfamilies. FEATURES ?Widesupplyvoltagerangeof1.2Vto3.6V ?InaccordancewithJEDECstandardno.8-1A. ?Inputsacceptvoltagesupto5.5V ?CMOSlowpowerc	PHIPhilips Semiconductors 飛利浦荷蘭皇家飛利浦	PHI
HD74LVC74	文件：48.32 Kbytes Page：9 Pages	DualD-typeFlipFlopswithPresetandClear Description TheHD74LVC74hasindependentdata,preset,clear,andclockinputsQandQoutputsina14pinpackage.Thelogiclevelpresentatthedatainputistransferredtotheoutputduringthepositivegoingtransitionoftheclockpulse.Presetandclearareindependentoftheclockandac	HitachiHitachi Semiconductor 日立日立公司	Hitachi

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