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HEF40175BT數(shù)據(jù)手冊(cè)集成電路（IC）的觸發(fā)器規(guī)格書(shū)PDF
| 廠商型號(hào) |
HEF40175BT |
| 參數(shù)屬性 | HEF40175BT 封裝/外殼為16-SOIC（0.154"，3.90mm 寬）；包裝為卷帶（TR）剪切帶（CT）Digi-Reel? 得捷定制卷帶；類別為集成電路（IC）的觸發(fā)器；產(chǎn)品描述：IC FF D-TYPE SNGL 4BIT 16SO |
| 功能描述 | Quad D-type flip-flop |
| 封裝外殼 | 16-SOIC（0.154"，3.90mm 寬） |
| 制造商 | Nexperia Nexperia B.V. All rights reserved |
| 中文名稱 | 安世 安世半導(dǎo)體(中國(guó))有限公司 |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-8-18 23:01:00 |
| 人工找貨 | HEF40175BT價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
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更多HEF40175BT規(guī)格書(shū)詳情
描述 Description
The HEF40175B is a quad edge-triggered D-type flip-flop with four data inputs (D0 to D3), a clock input (CP), an overriding asynchronous master reset input (MR), four buffered outputs (Q0 to Q3), and four complementary buffered outputs (Q0 to Q3). Information on D0 to D3 is transferred to Q0 to Q3 on the LOW-to-HIGH transition of CP if MR is HIGH. When LOW, MR resets all flip-flops (Q0 to Q3 = LOW; Q0 to Q3 = HIGH), independent of CP and D0 to D3.
It operates over a recommended VDD power supply range of 3 V to 15 V referenced to VSS (usually ground). Unused inputs must be connected to VDD, VSS, or another input.
特性 Features
? Fully static operation
? 5 V, 10 V, and 15 V parametric ratings
? Standardized symmetrical output characteristics
? Specified from –40 ℃ to +125 ℃
? Complies with JEDEC standard JESD 13-B
應(yīng)用 Application
? Shift registers
? Buffer/storage register
? Pattern generator
技術(shù)參數(shù)
- 制造商編號(hào)
：HEF40175BT
- 生產(chǎn)廠家
：Nexperia
- VCC (V)
：3.0?-?15
- Logic switching levels
：CMOS
- Output drive capability (mA)
：± 2.4
- tpd (ns)
：25
- fmax (MHz)
：45
- Power dissipation considerations
：low
- Tamb (°C)
：-40~85
- Rth(j-a) (K/W)
：81
- Ψth(j-top) (K/W)
：4.7
- Rth(j-c) (K/W)
：39.8
- Package name
：SO16
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
恩XP |
24+ |
NA/ |
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詢價(jià) | ||
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恩XP |
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