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UPD48576236FF-E18-DW1中文資料瑞薩數(shù)據(jù)手冊(cè)PDF規(guī)格書(shū)
| 廠商型號(hào) |
UPD48576236FF-E18-DW1 |
| 功能描述 | 576M-BIT Low Latency DRAM Common I/O |
| 文件大小 |
1.12946 Mbytes |
| 頁(yè)面數(shù)量 |
53 頁(yè) |
| 生產(chǎn)廠商 | Renesas Technology Corp |
| 企業(yè)簡(jiǎn)稱 |
RENESAS【瑞薩】 |
| 中文名稱 | 瑞薩科技有限公司官網(wǎng) |
| 原廠標(biāo)識(shí) |  |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-8-4 10:10:00 |
| 人工找貨 | UPD48576236FF-E18-DW1價(jià)格和庫(kù)存，歡迎聯(lián)系客服免費(fèi)人工找貨 |
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UPD48576236FF-E18-DW1規(guī)格書(shū)詳情
特性 Features
? SRAM-type interface
? Double-data-rate architecture
? PLL circuitry
? Cycle time: 1.875 ns @ tRC = 15 ns
2.5 ns @ tRC = 15 ns
2.5 ns @ tRC = 20 ns
3.3 ns @ tRC = 20 ns
? Non-multiplexed addresses
? Multiplexing option is available.
? Data mask for WRITE commands
? Differential input clocks (CK and CK#)
? Differential input data clocks (DK and DK#)
? Data valid signal (QVLD)
? Programmable burst length: 2 / 4 / 8 (x9 / x18 / x36)
? User programmable impedance output (25 Ω - 60 Ω)
? JTAG boundary scan
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫(kù)存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
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24+ |
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SOP |
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詢價(jià) | ||
NEC |
97+ |
SSOP |
130 |
原裝現(xiàn)貨海量庫(kù)存歡迎咨詢 |
詢價(jià) | ||
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23+ |
BGA |
96 |
詢價(jià) | |||
NEC |
23+ |
SSOP |
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詢價(jià) | |||
RENESAS/瑞薩 |
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