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PLL102-108	文件：165.16 Kbytes Page：10 Pages	Programmable DDR Zero Delay Clock Driver DESCRIPTIONS ThePLL102-108isazerodelaybufferthatdistributesasingle-endedclockinputtotenpairsofdifferentialclockoutputsandonefeedbackclockoutput.Outputsignaldutycyclesareadjustedto50,independentofthedutycycleatCLK_INT.ThePLLcanbebypassedfortestpurpose	PLL PhaseLink Corporation	PLL
PLL102-108XC	文件：165.16 Kbytes Page：10 Pages	Programmable DDR Zero Delay Clock Driver DESCRIPTIONS ThePLL102-108isazerodelaybufferthatdistributesasingle-endedclockinputtotenpairsofdifferentialclockoutputsandonefeedbackclockoutput.Outputsignaldutycyclesareadjustedto50,independentofthedutycycleatCLK_INT.ThePLLcanbebypassedfortestpurpose	PLL PhaseLink Corporation	PLL
PLL102-108XI	文件：165.16 Kbytes Page：10 Pages	Programmable DDR Zero Delay Clock Driver DESCRIPTIONS ThePLL102-108isazerodelaybufferthatdistributesasingle-endedclockinputtotenpairsofdifferentialclockoutputsandonefeedbackclockoutput.Outputsignaldutycyclesareadjustedto50,independentofthedutycycleatCLK_INT.ThePLLcanbebypassedfortestpurpose	PLL PhaseLink Corporation	PLL
PLL102-108XM	文件：165.16 Kbytes Page：10 Pages	Programmable DDR Zero Delay Clock Driver DESCRIPTIONS ThePLL102-108isazerodelaybufferthatdistributesasingle-endedclockinputtotenpairsofdifferentialclockoutputsandonefeedbackclockoutput.Outputsignaldutycyclesareadjustedto50,independentofthedutycycleatCLK_INT.ThePLLcanbebypassedfortestpurpose	PLL PhaseLink Corporation	PLL

詳細(xì)參數(shù)

型號：
PLL102-108
制造商：
PLL
制造商全稱：
PLL
功能描述：
Programmable DDR Zero Delay Clock Driver

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更多PLL102-108供應(yīng)商更新時間2025-7-28 16:00:00

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