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MC100EL35

JK Flip-Flop

Description TheMC10EL/100EL35isahighspeedJKflip-flop.TheJ/Kdataentersthemasterportionoftheflip-flopwhentheclockisLOWandistransferredtotheslave,andthustheoutputs,uponapositivetransitionoftheclock.Theresetpinisasynchronousandisactivatedwithalogic

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MC100EL35

MC100EL35: ECL JK Flip-Flop; 525ps Propagation Delay\n2.2GHz Toggle Frequency\nESD Protection: > 1 kV HBM, > 100 V MM\nPECL Mode Operating Range: VCC= 4.2 V to 5.7 with VEE= 0 V\nNECL Mode Operating Range: VCC= 0 V with VEE= -4.2 V to -5.7 V\nInternal Input Pulldown Resistors on J, K, CLK, and R\nMeets or Exceeds JEDEC Spec EIA/JESD78 IC Latchup Test\nMoisture Sensitivity Level 1For Additional Information, see Application Note AND8003/D\nFlammability Rating: UL-94V-0 @ 0.125 in, Oxygen Index: 28 to 34\nTransistor Count = 81 devices\nPb-Free Packages are Available\n;

The MC10EL/100EL35 is a high speed JK flip-flop. The J/K data enters the master portion of the flip-flop when the clock is LOW and is transferred to the slave, and thus the outputs, upon a positive transition of the clock. The reset pin is asynchronous and is activated with a logic HIGH.

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MC100EL35

5V ECL JK Flip-Flop

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MC100EL35D

5V ECL JK Flip-Flop

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MC100EL35D

Evaluation Board Manual for High Frequency SOIC 8

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MC100EL35DG

5V ECL JK Flip-Flop

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MC100EL35DG

5 V ECL JK Flip??lop

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MC100EL35DR2

5V ECL JK Flip-Flop

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MC100EL35DR2G

5V ECL JK Flip-Flop

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MC100EL35DT

5V ECL JK Flip-Flop

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技術(shù)參數(shù)

  • Compliance：

    Pb-freeHalide free

  • Status：

    ?Active??

  • Description：

    ?ECL JK Flip-Flop?

  • Type：

    JK-Type

  • Bits：

    1

  • Input Level：

    ECL

  • Output Level：

    ECL

  • VCC Typ (V)：

    5

  • tJitter Typ (ps)：

    1

  • tpd Typ (ns)：

    0.525

  • tsu Min (ns)：

    0.15

  • th Min (ns)：

    0.25

  • trec Typ (ns)：

    0.2

  • tR & tF Max (ps)：

    350

  • fToggle Typ (MHz)：

    2200

  • Package Type：

    SOIC-8

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更多MC100EL35供應(yīng)商 更新時(shí)間2025-7-29 16:50:00

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