HEF4024BF中文資料飛利浦?jǐn)?shù)據(jù)手冊(cè)PDF規(guī)格書
| 廠商型號(hào) |
HEF4024BF |
| 功能描述 | 7-stage binary counter |
| 文件大小 |
42.52 Kbytes |
| 頁面數(shù)量 |
5 頁 |
| 生產(chǎn)廠商 | Philips Semiconductors |
| 企業(yè)簡稱 |
PHI【飛利浦】 |
| 中文名稱 | 荷蘭皇家飛利浦 |
| 原廠標(biāo)識(shí) | PHILIPS |
| 數(shù)據(jù)手冊(cè) | |
| 更新時(shí)間 | 2025-8-1 15:43:00 |
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HEF4024BF規(guī)格書詳情
DESCRIPTION
The HEF4024B is a 7-stage binary ripple counter with a clock input (CP), and overriding asynchronous master reset input (MR) and seven fully buffered parallel outputs (O0 to O6). The counter advances on the HIGH to LOW transition of CP. A HIGH on MR clears all counter stages and forces all outputs LOW, independent of CP. Each counter stage is a static toggle flip-flop.
| 供應(yīng)商 | 型號(hào) | 品牌 | 批號(hào) | 封裝 | 庫存 | 備注 | 價(jià)格 |
|---|---|---|---|---|---|---|---|
PHI |
2015+ |
DIP |
19889 |
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詢價(jià) | ||
PHI |
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DIP14 |
11520 |
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詢價(jià) | ||
PHI |
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DIP |
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PHI |
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PHI |
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DIP |
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PHI |
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PHI |
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DIP14 |
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PHI |
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PHI |
2023+ |
DIP-14 |
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PHI |
23+ |
DIP |
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詢價(jià) |
