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CY7C1350B-100AC

128Kx36PipelinedSRAMwithNoBLArchitecture

FunctionalDescription TheCY7C1350Bisa3.3V,128Kby36synchronous-pipelinedBurstSRAMdesignedspecificallytosupportunlimitedtrueback-to-backRead/Writeoperationswithouttheinsertionofwaitstates.TheCY7C1350BisequippedwiththeadvancedNoBusLatency?(NoBL?)logicrequiredt

CypressCypressSemiconductor

賽普拉斯賽普拉斯半導(dǎo)體公司

CY7C1350B-100AI

128Kx36PipelinedSRAMwithNoBLArchitecture

FunctionalDescription TheCY7C1350Bisa3.3V,128Kby36synchronous-pipelinedBurstSRAMdesignedspecificallytosupportunlimitedtrueback-to-backRead/Writeoperationswithouttheinsertionofwaitstates.TheCY7C1350BisequippedwiththeadvancedNoBusLatency?(NoBL?)logicrequiredt

CypressCypressSemiconductor

賽普拉斯賽普拉斯半導(dǎo)體公司

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更多CY7C1350B-100AXC供應(yīng)商 更新時(shí)間2025-7-27 10:21:00

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