74F112PC集成電路（IC）的觸發(fā)器規(guī)格書PDF中文資料
| 廠商型號 |
74F112PC |
| 參數(shù)屬性 | 74F112PC 封裝/外殼為16-DIP（0.300"，7.62mm）；包裝為袋；類別為集成電路（IC）的觸發(fā)器；產(chǎn)品描述：IC FF JK TYPE DUAL 1BIT 16DIP |
| 功能描述 | Dual JK Negative Edge-Triggered Flip-Flop |
| 封裝外殼 | 16-DIP（0.300"，7.62mm） |
| 文件大小 |
59.07 Kbytes |
| 頁面數(shù)量 |
6 頁 |
| 生產(chǎn)廠商 | Fairchild Semiconductor |
| 企業(yè)簡稱 |
FAIRCHILD【仙童半導體】 |
| 中文名稱 | 飛兆/仙童半導體公司官網(wǎng) |
| 原廠標識 | FAIRCHILD |
| 數(shù)據(jù)手冊 | |
| 更新時間 | 2025-8-5 19:02:00 |
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74F112PC規(guī)格書詳情
General Description
The 74F112 contains two independent, high-speed JK flip flops with Direct Set and Clear inputs. Synchronous state changes are initiated by the falling edge of the clock. Triggering occurs at a voltage level of the clock and is not directly related to the transition time. The J and K inputs can change when the clock is in either state without affecting the flip-flop, provided that they are in the desired state during the recommended setup and hold times relative to the falling edge of the clock. A LOW signal on SD or CD prevents clocking and forces Q or Q HIGH, respectively.
Simultaneous LOW signals on SD and CD force both Q and Q HIGH.
Asynchronous Inputs:
LOW input to SD sets Q to HIGH level
LOW input to CD sets Q to LOW level
Clear and Set are independent of clock
Simultaneous LOW on CD and SD makes both Q and Q HIGH
產(chǎn)品屬性
- 產(chǎn)品編號：
74F112PC
- 制造商：
onsemi
- 類別：
集成電路（IC） > 觸發(fā)器
- 系列：
74F
- 包裝：
袋
- 功能：
設置（預設）和復位
- 類型：
JK 型
- 輸出類型：
補充型
- 不同 V、最大 CL 時最大傳播延遲：
6.5ns @ 5V，50pF
- 觸發(fā)器類型：
負邊沿
- 電流 - 輸出高、低：
1mA，20mA
- 電壓 - 供電：
4.5V ~ 5.5V
- 工作溫度：
0°C ~ 70°C（TA）
- 安裝類型：
通孔
- 供應商器件封裝：
16-PDIP
- 封裝/外殼：
16-DIP（0.300"，7.62mm）
- 描述：
IC FF JK TYPE DUAL 1BIT 16DIP
| 供應商 | 型號 | 品牌 | 批號 | 封裝 | 庫存 | 備注 | 價格 |
|---|---|---|---|---|---|---|---|
FAIR |
24+/25+ |
265 |
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